解析:
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8、时序逻辑电路的置数端有效,则电路为()状态。
7、集成运放电路的两输入端外接()防止输入信号过大而损坏器件。
6、当74LS94的Q0经非门的输出与SL相连时,电路实现的功能为()。
5、JK触发器,当JK为()时,触发器处于置0状态。
4、当74LS94的Q3经非门的输出与Sr相连时,电路实现的功能为()。
3、晶闸管触发电路所产生的触发脉冲信号必须要()。
2、组合逻辑电路的比较器功能为()。
1、一片集成二—十进制计数器74L160可构成()进制计数器。
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